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对于网络通信协议来说,主节点与从节点之间传输协议和数据包不会存在错误;但是对于硬件电路来说,就需要采用一定的方法来保证主从式时间同步。当主从时钟不一致时,就会导致通信信号丢失;同时,当主从式时间不同步时,也会导致主从节点之间出现传输数据包错误、网络拓扑错误。注意:以下内容仅供参考。
1、原理介绍
在网络中,一个节点的时间信息通过时钟信号传递给另一个节点。一个时钟信号为1ns,如果另一个节点的时间信息为1ms,那么前者的时钟信号就是后者的2倍。如果后者的时钟信号也为10ms,那么两者之间就相差100ms。2、硬件实现
从时钟时间同步系统采用了 FPGA+ MCU的方案。时钟芯片采用的是片具有高精度、低功耗、高集成度和高性价比等特点,能满足大多数时钟产品的要求。另外,芯片内还集成了温度补偿、晶振驱动和时钟抖动补偿等电路模块,方便电路实现。工业级芯片工作时首先通过外部时钟源产生一个时钟信号,接着再将该信号作为时钟同步信号发送到主从时钟芯片中。同时,主从时钟芯片内部还集成了温度补偿和晶振驱动模块,在芯片内部的温度补偿电路和晶振驱动模块可以保证主从时钟芯片内部产生的时间信息是一致的;同时在晶振驱动电路中加入了可编程增益模块,可以根据实际需求对晶振进行调节以达到同步的目的。【本文标签】 从时钟时间同步
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